Logica NMOS: differenze tra le versioni
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{{F|elettronica|settembre 2012}}
[[File:NMOS NOR WITH RESISTIVE LOAD.PNG|thumb|Struttura interna di un [[MOSFET]] di tipo N.]]
La ''' Gli nMOS sono disposti nella cosiddetta "rete di pull-down" (PDN) tra l'uscita del circuito logico e la [[tensione elettrica|tensione]] di ingresso negativa, mentre un [[resistore]] è posizionato tra l'uscita e la [[tensione elettrica|tensione]] di ingresso positiva. Il circuito è disegnato in modo che l'uscita desiderata sia bassa, e quindi la rete PDN sia attiva, creando in tal modo una [[corrente elettrica|corrente]] tra l'ingresso e l'uscita.
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